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電子設(shè)備及其控制方法與流程

文檔序號:41873396發(fā)布日期:2025-05-09 18:47閱讀:來源:國知局

技術(shù)特征:

1.一種電子設(shè)備,包括:

2.如權(quán)利要求1所述的設(shè)備,其中,所述至少一個處理器還被配置為基于輸入數(shù)據(jù)的大小、輸出數(shù)據(jù)的大小、內(nèi)核數(shù)據(jù)的大小、或表示應(yīng)用內(nèi)核數(shù)據(jù)的距離的步幅的大小中的至少一個來確定填充數(shù)據(jù)的大小。

3.如權(quán)利要求1所述的設(shè)備,其中,所述至少一個處理器還被配置為:

4.如權(quán)利要求1所述的設(shè)備,其中,所述至少一個處理器還被配置為:

5.如權(quán)利要求4所述的設(shè)備,其中,所述至少一個處理器還被配置為:

6.如權(quán)利要求5所述的設(shè)備,其中,所述至少一個處理器還被配置為:

7.如權(quán)利要求5所述的設(shè)備,其中,所述至少一個處理器還被配置為:

8.如權(quán)利要求5所述的設(shè)備,其中,所述至少一個處理器還被配置為:

9.如權(quán)利要求5所述的設(shè)備,其中,所述至少一個處理器還被配置為:

10.如權(quán)利要求1所述的設(shè)備,其中,所述至少一個處理器還被配置為從包括在所述至少一個處理器中的內(nèi)核緩沖器獲取內(nèi)核數(shù)據(jù)。

11.一種電子設(shè)備的控制方法,所述電子設(shè)備存儲輸入數(shù)據(jù)并包括至少一個處理器,所述至少一個處理器包括卷積計算模塊、第一緩沖器、第二緩沖器和第三緩沖器,所述方法包括:

12.如權(quán)利要求11所述的方法,其中,獲取填充數(shù)據(jù),包括:基于輸入數(shù)據(jù)的大小、輸出數(shù)據(jù)的大小、內(nèi)核數(shù)據(jù)的大小、或表示應(yīng)用內(nèi)核數(shù)據(jù)的距離的步幅的大小中的至少一個來確定填充數(shù)據(jù)的大小。

13.如權(quán)利要求11所述的方法,

14.如權(quán)利要求11所述的方法,

15.如權(quán)利要求14所述的方法,


技術(shù)總結(jié)
當獲取用于輸入數(shù)據(jù)的卷積計算指令時,電子裝置獲取與輸入數(shù)據(jù)對應(yīng)的填充數(shù)據(jù),基于緩沖器的大小和填充數(shù)據(jù)的大小來識別計算處理單元,基于計算處理單元和緩沖器的大小將輸入數(shù)據(jù)和填充數(shù)據(jù)分類為多個目標區(qū)域,將所述多個目標區(qū)域中的一個目標區(qū)域存儲在第一緩沖器、第二緩沖器或第三緩沖器中,基于計算處理單元和所述多個目標區(qū)域獲取用于卷積計算的目標數(shù)據(jù),并且控制卷積計算模塊基于目標數(shù)據(jù)和內(nèi)核數(shù)據(jù)執(zhí)行卷積計算指令。

技術(shù)研發(fā)人員:陳喆奎,白振煥,樸哉彥,李政勛
受保護的技術(shù)使用者:三星電子株式會社
技術(shù)研發(fā)日:
技術(shù)公布日:2025/5/8
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